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[判断题]

赋值指令(=)能用于输入过程映像寄存器。()

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更多“赋值指令(=)能用于输入过程映像寄存器。()”相关的问题

第1题

在一条单总线结构的计算机中,用一条总线连接了指令寄存器IR、程序计数器PC、存储器地址寄存器MAR、
存储器数据寄存器MDR、通用寄存器R0~R7的输入和输出端。ALU的两个输入端分别与总线和寄存器Y的输出端相连,ALU的输出端与寄存器Z的输入端相连。Y的输入端与总线连接,Z的输出端与总线连接。该机有下列指令: ADD R1,R2,R3 ;(R2)+(R3)→R1 JMP * K ;(PC)+(K-1)→PC LOAD R1,mem ;(mem)→R1 STORE mem,R2 ;R2→mem 写出控制器执行上述指令的微操作及节拍安排。

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第2题

在CPU中,用于暂存指令的部件是( )。

A.累加器寄存器

B.指令寄存器

C.程序计数器

D.数据缓冲寄存器

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第3题

在CPU中,用于指向指令后续地址的部件是( )。

A.程序计数器

B.主存地址寄存器

C.状态条件寄存器

D.指令译码器

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第4题

在控制器中,部件()用于存放下一条指令的地址。

A.指令指针IP

B. 地址寄存器AR

C. 指令寄存器IR

D. 程序计数器PC

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第5题

给定以下的假设,试计算直接映像Cache和2路组相联映像Cache的平均访问时间以及CPU的性能。由计算结
果能得出什么结论? ①理想Cache情况下的CPI为2.0,时钟周期为2 ns,平均每条指令访存1.2次。 ②两者Cache容量均为64 KB,块大小都是32 B。 ③组相联映像Cache中的多路选择器使CPU的时钟周期增加了10%。 ④这两种Cache的失效开销都是80 ns。 ⑤命中时间为1个时钟周期。 ⑥64 KB直接映像Cache的失效率为1.4%,64 KB 2路组相联映像Cache的失效率为1.0%。

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第6题

某假想机主要部件如图9.11所示,其中: LA ALU的A输入端选择器 LB ALU的B输
入端选择器 M 主存 MDR 主存数据寄存器 IR 指令寄存器 MAR 主存地址寄存器 PC 程序计数器 R0~R3 通用寄存器 C、D 暂存器

(1)补充各种部件之间的主要连接线,并注明数据流动方向。 (2)写出ADD @R1,@R2和SUB @R1,@R2指令取指阶段和执行阶段的信息流程。R1寄存器中存放源操作数的地址,R2寄存器中存放的是目的操作数的地址。

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第7题

某机指令字长32位,共有64种操作,若CPU内有16个32位的通用寄存器,采用寄存器一存储器型指令,能直
接寻址的最大主存空间是________,如果采用通用寄存器作为基址寄存器,则寄存器一存储器型指令能寻址的最大主存空间是________。

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第8题

计算机硬件系统中,______用于存放当前要执行的命令。

A.指令寄存器

B.译码器

C.指令计数器

D.时序节拍发生器

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第9题

某机字长32位,CPU内有32个32位的通用寄存器,设计一种能容纳64种操作的指令系统,设指令字长等于机
器字长。 (1)如果主存可直接或间接寻址,采用寄存器—存储器型指令,能直接寻址的最大存储空间是多少?画出指令格式。 (2)如果采用通用寄存器作为基址寄存器,则上述寄存器—存储器型指令的指令格式有何特点?画出指令格式并指出这类指令可访问多大的存储空间?

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第10题

已知单总线计算机结构如图9.7所示,其中XR为变址寄存器,EAR为有效地址寄存器,LATCH为暂存器。假设
指令地址已存于PC中,画出ADD * D指令周期信息流程图,并列出相应的控制信号序列。 说明: (1)ADD * D指令字中*表示相对寻址,D为相对位移量。 (2)寄存器的输入和输出均受控制信号控制,如PCi表示PC的输入控制信号,又如MDRo表示MDR的输出控制信号。 (3)凡是需要经过总线实现寄存器之间的传送,需在流程图中注明,如PC→Bus→MAR,相应的控制信号为PCo和MARi。

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第11题

已知单总线计算机结构如图9.7所示,其中M为主存,XR为变址寄存器,EAR为有效地址寄存器,LATCH为暂存
器。假设指令地址已存于PC中,画出ADD X,D指令周期信息流程图,并列出相应的控制信号序列。

说明: (1)ADD X,D指令字中x为变址寄存器XR,D为形式地址。 (2)寄存器的输入和输出均受控制信号控制,如PCi表示PC的输入控制信号,又如MDRo表示MDR的输出控制信号。 (3)凡是需要经过总线实现寄存器之间的传送,需在流程图中注明,如PC→Bus→MAR,相应的控制信号为PCo和MARi。

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