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[主观题]

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREF=10 V。为保证VR

EF偏离标准值所引起的误差

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREFLSB(现在的LSB应为d2),允许VREF的最大变化△VREF是多少?VREF的相对稳定度

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREF应为多少?

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREF

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第1题

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应下降沿,输入电压

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应下降沿,输入电压V1=10V,试求: (1)画出N,A,B各点波形; (2)求Vi对应Vi=10V时,输出数字量D3D2D1D0是多少?

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应

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第2题

在图10.1.2所示的倒T形电阻网络DAC中,设VREF=5 V,RF=R=10 kgl,求对应于输入4位二进制数码为0101,
0110,1101时的输出电压。

在图10.1.2所示的倒T形电阻网络DAC中,设VREF=5 V,RF=R=10 kgl,求对应于输

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第3题

在图10.1.1所示的权电阻网络DAC中,设R=10 kΩ,RF=5 kΩ。试求其他权电阻的阻值。若VREF=5 V,输入的二
进制数码D3D2D1D0=1101,求输出电压vO。

在图10.1.1所示的权电阻网络DAC中,设R=10 kΩ,RF=5 kΩ。试求其他权电阻的阻值。若

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第4题

图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135DAC为DAC1210(12位MDAC)。在不考

图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135

图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135DAC为DAC1210(DAC为DAC1210(12位MDAC)。在不考虑数据处理的情况下,试设计控制ADC采集输入数据,并直接由DAC输出反馈控制电压Vo的控制器流程,给出时序图和电路图。

图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135DAC为DAC1210(

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第5题

图6-17所示DAC的满量程输出电压为±5V,若输入数字量D=10110,分别指出下述两种代码输入时,相应的输

图6-17所示DAC的满量程输出电压为±5V,若输入数字量D=10110,分别指出下述两种代码输入时,相应的输出模拟电压Vo值: (1)D为偏移二进制码; (2)D为2的补码。

图6-17所示DAC的满量程输出电压为±5V,若输入数字量D=10110,分别指出下述两种代码输入时

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第6题

在图4-55所示差分放大电路中,已知RC=50kΩ,R1=10kΩ,R2=3.5kΩ,VCC=10V,VEE=-10V,β=100,试求最大输入共模电压

在图4-55所示差分放大电路中,已知RC=50kΩ,R1=10kΩ,R2=3.5kΩ,VCC=10V,VEE=-10V,β=100,试求最大输入共模电压范围Vic。设T1、T2、T3管的饱和压降VCE(sat)均为0.3V。

在图4-55所示差分放大电路中,已知RC=50kΩ,R1=10kΩ,R2=3.5kΩ,VCC=10V

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第7题

在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输
在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输

在图LT4-23所示两级共发放大器的交流通路中,已知在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L试估算该电路的土限频率fH.(忽略第二级输入电容对第一级的影响.)

在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L

在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L

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第8题

在图NT6-3所示锁相环路中,当输入频率发生突变Δωi=100rad/s时,要求环路的稳态相位误差为0.1
rad,试确定放大器的增益A1.已知在图NT6-3所示锁相环路中,当输入频率发生突变Δωi=100rad/s时,要求环路的稳态相位误差为.

在图NT6-3所示锁相环路中,当输入频率发生突变Δωi=100rad/s时,要求环路的稳态相位误差为

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第9题

在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10 V。为保证VREF偏离标

在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10 V。为保证VREF偏离标准值所引起的误差小于

在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10 LSB,试计算相对稳定度应取多少?

在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10

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第10题

在图NP4-31所示的晶体二极管包络检波电路中,已知R1=2kΩ,R2=3kΩ,R3=20kΩ,Ri2=
27kΩ,若要求不产生负峰切割失真,试求输入调幅波vs的最大调幅系数M。

在图NP4-31所示的晶体二极管包络检波电路中,已知R1=2kΩ,R2=3kΩ,R3=20kΩ,Ri

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