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[主观题]

已知某8位机的主存采用半导体存储器，其地址码为18位，采用4K×4位的静态RAM芯片组成该机所允许的最

大主存空间，并选用模块板形式，问： (1)若每个模块板为32K×8位，共需几个模块板？ (2)每个模块板内共有多少片RAM芯片？ (3)主存共需要多少RAM芯片？CPU如何选择各模块板？如何选择具体芯片(说明选用的器件及地址码的分配)？

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发布时间：2020-09-28

更多“已知某8位机的主存采用半导体存储器，其地址码为18位，采用4K×4位的静态RAM芯片组成该机所允许的最”相关的问题

第1题

已知某64位机主存采用半导体存储器，其地址码为26位，若使用4M×8位的DRAM芯片组成该机所允许的最大主存空间，并选用内存条结构形式，问：（1）每个内存条内共有多少DRAM芯片？（2）主存共需多少DRAM芯片？

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第2题

某8位计算机采用单总线结构，地址总线17根(A16~0，A16为高位)，数据总线8根双向(D7~0)，控制信号(

某8位计算机采用单总线结构，地址总线17根（A16~0，A16为高位)，数据总线8根双向（D7~0)，控制信号（

高电平为读，低电平为写)。

已知该机存储器地址空间从0连续编址，其地址空间分配如下：最低8K为系统程序区，由ROM芯片组成;紧接着40K为备用区，暂不连接芯片;而后78K为用户程序和数据空间，用静态RAM芯片组成;最后2K用于I/O设备(与主存统一编址)。现有芯片如下：

SRAM：16K×8位，其中CS：为片选信号，低电平有效，WE：为写控制信号，低电平写，高电平读。

ROM：8K×8位，其中CS：为片选信号，低电平有效，OE：为读出控制，低电平读出有效。

译码器：3―8译码器，输出低电平有效;为使能信号，低电平时译码器功能有效。

其它“与、或”等逻辑门电路自选。

(1)请问该主存需多少SRAM芯片？

(2)试画出主存芯片与CPU的连接逻辑图。

(3)写出各芯片地址分配表。

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第3题

某计算机的主存地址空间中，从地址0000H～3FFFH为ROM存储区域，从地址 4000H～7FFFH为RAM的存储

某计算机的主存地址空间中，从地址0000H～3FFFH为ROM存储区域，从地址

某计算机的主存地址空间中，从地址0000H～3FFFH为ROM存储区域，从地址 4000H～7FFF 4000H～7FFFH为RAM的存储区域。RAM的控制信号为CS和WE，CPU的地址线为A15～A0，数据线为8位的D7～D0线，控制信号有读写控制R／W和访存请求MREQ，要求： (1)画出地址译码方案。 (2)如果ROM和RAM存储器芯片都采用8 K×1位的芯片，试画出存储器与CPU的连接图。 (3)如果ROM存储器芯片采用8K×8位的芯片，RAM存储器芯片采用4K×8位的芯片，试画出存储器与CPU的连接图。 (4)如果ROM存储器芯片采用16K×8位的芯片，RAM存储器芯片采用8K×8位的芯片，试画出存储器与CPU的连接图。

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第4题

某机指令字长32位,共有64种操作,若CPU内有16个32位的通用寄存器,采用寄存器－存储器型指令,能直接寻址的最大主存空间是（) 。如果采用通用寄存器作为基址寄存器,则寄存器－存储器型指令能寻址的最大主存空间是（)。

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第5题

某机指令字长32位，共有64种操作，若CPU内有16个32位的通用寄存器，采用寄存器一存储器型指令，能直

接寻址的最大主存空间是________，如果采用通用寄存器作为基址寄存器，则寄存器一存储器型指令能寻址的最大主存空间是________。

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第6题

Cache是( )存储器，是为了解决CPU和( )之间速度上不匹配而采用的一项重要硬件技术。

A.半导体材料做的内存；内存

B.高速缓冲；主存

C.内部；辅助存储器

D.外部；硬盘

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第7题

已知某机采用微程序控制方式，其控制存储器容量为5 12×48位。微程序可在整个控制存储器中实现转移，

可控制微程序转移的条件共4个，微指令采用水平型格式，后继微指令地址采用断定方式，如下所示：

已知某机采用微程序控制方式，其控制存储器容量为5 12×48位。微程序可在整个控制存储器中实现转移，则微指令中3个字段分别应为多少位？

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第8题

设某机共能完成120种操作，CPU有8个通用寄存器（12位)，主存容量为16K字，采用寄存器—存储器型指令。

设某机共能完成120种操作，CPU有8个通用寄存器(12位)，主存容量为16K字，采用寄存器—存储器型指令。 (1)欲使指令可直接访问主存的任一地址，指令字长应取多少位？ (2)若在上述设计的指令字中设置一寻址特征位X，且X=0表示某个寄存器作基址寄存器，画出指令格式。试问采用基址寻址可否访问主存的任一单元？为什么？如不能，提出一种方案，使指令可访问主存的任一位置。 (3)若指令字长等于存储字长，且主存容量扩大到64K字，在不改变硬件结构的前提下，可采用什么方法使指令可访问存储器的任一位置？

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第9题

某计算机字长16位，主存容量128KW，请用16K×8位的静态RAM芯片和32K×16位的ROM芯片，为该机设计一个主存储器。要求18000H~1FFFFH为ROM区，其余为RAM区。画出存储器结构及其与CPU连接的框图。

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第10题

采用组相联联映像的CaChe存储器容量为512 KB。容量为16 MB的主存采用模8交叉，每个分体宽度为8

位。若采用按地址访问的存储器来构造相联目录表，实现主存地址到CaChe地址的变换，并约定采用8个外相等比较电路。请设计此相联目录表，求出该表的行数、每行的总宽度及每个比较电路的位数。

存放数据需要多少个页面？

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