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[主观题]

图7.6.1是一个1 6×4位的ROM,A3A2A1A。为地址输入,D3,D2,D1,D0为数据输出。若将D3,D2,D1,D0视为A3,A

2,A1,A0的逻辑函数,试写出D3,D2,D1,D0的逻辑表达式。

图7.6.1是一个1 6×4位的ROM,A3A2A1A。为地址输入,D3,D2,D1,D0为数据输出

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第1题

图9.1是一个字CRT显示器框图,可显示3 OOO个汉字,每字由11×1 6点阵组成,字间间隔1点,两排字间间隔
4线,32字/排,12排/屏。一个汉字编码占2 B。帧频50 Hz,帧回扫和行回扫均占扫描时间的20%(扫描时间包括正扫和回扫)。行频可在60~70 IJLs间选择。问: (1)RAM的容量是多少? (2)ROM的容量是多少? (3)各计数器的位数分别是多少?时钟频率是多少(不考虑扫描非线性)?

图9.1是一个字CRT显示器框图,可显示3 OOO个汉字,每字由11×1 6点阵组成,字间间隔1点,

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第2题

试用ROM设计一个乘法器。已知输入是两个2位二进制数 A1A0和B1B0,输出是二者的乘积,并用4位二进制数表示,即Y3

试用ROM设计一个乘法器。已知输入是两个2位二进制数 A1A0和B1B0,输出是二者的乘积,并用4位二进制数表示,即Y3Y2Y1Y0。要求画出ROM电路的与或逻辑阵列。

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第3题

试用ROM实现一个乘法器。已知输入是两个二进制数M1M0和N1N0输出是两者的乘积,并用4位二进制数表示
,即Y3Y2Y1Y0。

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第4题

用16×4位的ROM设计一个将2个2位二进制数相乘的乘法器电路,列出ROM的数据表,画出存储矩阵的点阵图。

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第5题

图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表所示。试画出在CP信

号连续作用下D3、D2、D1、D0输出的电压波形,并说明它们和CP信号频率之比。

图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表

地址输入数据输出
A3A2A1A0D3D2D1D0
0 0 0 0

0 0 0 1

0 0 1 0

0 0 1 1

0 1 0 0

0 1 0 1

0 1 1 0

0 1 1 1

1 0 0 0

1 0 0 1

1 0 1 0

1 0 1 1

1 1 0 0

1 1 0 1

1 1 1 0

1 1 1 1

1 1 1 1

0 0 0 0

0 0 1 1

0 1 0 0

0 1 0 1

1 0 1 0

1 0 0 1

1 0 0 0

1 1 1 1

1 1 0 0

0 0 0 1

0 0 1 0

0 0 0 1

0 1 0 0

0 1 1 1

0 0 0 0

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第6题

用两片1024×8位的EPROM接成一个数码转移器,将10位二进制数转移成等值的4位二-十进制数。 (1)

用两片1024×8位的EPROM接成一个数码转移器,将10位二进制数转移成等值的4位二-十进制数。 (1)试画出电路连接图,标明输入和输出; (2)当地址输入A9A8A7A6A5A4A3A2A1A0 分别为0000000000,1000000000,1111111111时,两片EPROM中对应地址中的数据各为何值?

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第7题

设计存储器。 地址总线A15~A0(低),存储器地址空间为3000H~67FFH,按字节编址。其中,3000H~4FFF

设计存储器。 地址总线A15~A0(低),存储器地址空间为3000H~67FFH,按字节编址。其中,3000H~4FFFH为ROM区,选用EPROM芯片(4K×2位/片);5000H~67FFH为RAM区,选用DRAM芯片(2K×4位/片)。 (1)据存储器容量,EPROM芯片和DRAM芯片各需多少片?分别选择一个正确答案。 (a)EPROM芯片 (b)DRAM芯片 ①4片②6片③8片④12片 (2)EPROM芯片和DRAM芯片各连入哪几根地址线?分别选择一个正确答案。 (a)EPROM芯片 (b)DRAM芯片 ①A10~A0②A12~A0③A11~A0④A9~A0 (3)分别写出5个片选信号CS0、CS1、CS2、CS3、CS4的逻辑式。

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第8题

如图是一个正方体的展开图,与4号相对的面是()面

A.2

B.5

C.6

D.1

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第9题

某ROM芯片有8根地址线(A0~A7),有4根数据输出线(D0~D3),则ROM的容量为()。A.16×4位B.32×4位C.2

某ROM芯片有8根地址线(A0~A7),有4根数据输出线(D0~D3),则ROM的容量为()。

A.16×4位

B.32×4位

C.256×4位

D.1024×1位

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第10题

设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高

电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及74138译码器和各种门电路,如图所示。画出CPU与存储器连接图,要求:1.主存地址空间分配:8000H~87FFH为系统程序区;8800H~8BFFH为用户程序区。

2.合理选用上述存储芯片,说明各选几片?

3.详细画出存储芯片的片选逻辑。

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