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[单选题]

RM电路由地址译码器和存储体构成,若译码器有十个地址输入线,则最多可有()个字。

A.210

B.104

C.10

D.102

答案
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更多“RM电路由地址译码器和存储体构成,若译码器有十个地址输入线,则最多可有()个字。”相关的问题

第1题

CPU 中的译码器主要用于________。A.地址译码B.指令译码C.选择多路数据至ALU

CPU 中的译码器主要用于________。

A.地址译码

B.指令译码

C.选择多路数据至ALU

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第2题

一个NMOS—ROM存储矩阵如图6.4.2所示。图中存储阵列的“×”表示字线和位线间接有NMOS管,接法见左上方
的虚线框。

(1)若地址译码器的输入A2A1A0取值为000、001、010、…、111时,其相应的输出Y0、Y1、Y2、…、Y7为高电平。试问输入A2A1A为010、011、101时,ROM相应的输出状态是什么? (2)若已知ROM的输出为10110011,试问地址译码器的输入A2A1A0应该是什么状态?

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第3题

存储器的地址空间分布图和存储器的地址译码电路分别如图4.17(a)和(b)所示,图(b)中的A、B两组跨接

存储器的地址空间分布图和存储器的地址译码电路分别如图4.17(a)和(b)所示,图(b)中的A、B两组跨接端子可按要求分别进行接线,如1~4中的任一端子可以和5~7中的任一端子跨接。74139是2线—4线译码器(译码输出低电平有效),使能端G接地表示译码器处于正常译码状态。试完成A组跨接端子与B组跨接端子内部的连接,以便使地址译码电路按图(a)的要求进行正确寻址。

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第4题

若由高速缓存、主存、硬盘构成的三级存储体系,则CPU访问该存储系统时发送的地址为()。A.高速缓

若由高速缓存、主存、硬盘构成的三级存储体系,则CPU访问该存储系统时发送的地址为()。

A.高速缓存地址

B.虚拟地址

C.主存物理地址

D.磁盘地址

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第5题

试分析图3.3.11所示电路的功能。该电路由优先编码器74HCl47、七段译码器CD4511和七段数字显示器等
组成。

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第6题

设某微机的寻址范围为64K,接有8片8K的存储芯片,存储芯片的片选信号为CS,要求: (1)画出选片

设某微机的寻址范围为64K,接有8片8K的存储芯片,存储芯片的片选信号为CS,要求: (1)画出选片译码逻辑电路(可选用74138译码器)。 (2)写出每片RAM的地址范围。 (3)如果运行时发现只有以0000H为起始地址的一片存储芯片不能读/写,分析故障原因,如何解决? (4)如果发现只能对第1~4片RAM进行读/写,试分析故障原因。

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第7题

SRAM通常由地址译码器、存储阵列和输入/输出电路三部分组成。 ()此题为判断题(对,错)。
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第8题

如图所示,若低位地址(A0~A11)接在内存芯片地址引脚上,高位地址(A12~A19)进行片选译码(其中,A14和

如图所示,若低位地址(A0~A11)接在内存芯片地址引脚上,高位地址(A12~A19)进行片选译码(其中,A14和A16没有参加译码),且片选信号低电平有效,则对图所示的译码电路,不属于此译码空间的地址是()。 [*]

A.AB000H~ABFFFH

B.BB000H~BBFFFH

C.EF000H~EFFFFH

D.FE000H~FEFFFH

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第9题

为构成4 096×4位的RAM,需要()片1 024×1位的RAM,并且需要有()地址译码以完成寻址操作。A.8

为构成4 096×4位的RAM,需要()片1 024×1位的RAM,并且需要有()地址译码以完成寻址操作。

A.8片,10位

B.16片,12位

C.16片,14位

D.10片,12位

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第10题

若存储芯片中行、列地址译码器的输入引脚个数分别为6、4,则它们的输出线(即行选线和列选线)总共有______条。

A.10

B.128

C.80

D.256

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第11题

设有一(7,4)系统循环码,其生成多项式为g(x)=x3+x+1。假设码字自左至右对应码多项式的次数自高至低

设有一(7,4)系统循环码,其生成多项式为g(x)=x3+x+1。假设码字自左至右对应码多项式的次数自高至低,假设系统位在左。 (1)求信号00111的编码结果; (2)若译码器输入0101001,求其码多项式模g(x)所得的伴随式,并给出译码结果; (3)写出该码的系统码形式的生成矩阵及相应的监督矩阵。

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