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答案
更多“存放在两个寄存器中的n位长补码，欲实现串行加减运算，最基本的电路应有________和________，前者用”相关的问题
第1题
画出实现n位小数(不包括符号位在内)的补码一位乘运算器框图。要求： (1)指出寄存器和全加器位数； (2)详细画出最低位全加器的输入电路； (3)描述重复加和移位的操作； (4)指出加和移位次数。
第2题
画出实现补码Booth算法的运算器框图(假设数值取n位)。要求： (1)指出寄存器和全加器的位数； (2)详细画出最低位全加器的输入电路； (3)指出加和移位的次数； (4)描述Booth算法重复加和移位的过程。
第5题
设机器数字长为n位(不包括符号位)，画出补码加减交替法的运算器框图(图中必须反映补码加减法算法)，要求： (1)寄存器和全加器均用方框表示； (2)指出每个寄存器的位数及寄存器中操作数的名称； (3)详细画出第5位全加器的输入逻辑电路(设第n位为最末位)； (4)描述补码加减交替操作和上商操作。
第6题
设机器数字长为n位(不包括符号位)，画出补码加减交替法的运算器框图(图中必须反映补码加减交替法算法1)，要求： (1)寄存器和全加器均用方框表示； (2)指出每个寄存器的位数及寄存器中操作数的名称； (3)详细画出最末位全加器的输入逻辑电路； (4)描述补码加减交替操作和上商操作。
第7题
设机器数字长为n位(不包括符号位)，画出补码一位乘的运算器框图(图中必须反映补码一位乘算法)，要求： (1)寄存器和全加器均用方框表示； (2)指出每个寄存器的位数及寄存器中操作数的名称； (3)详细画出第5位全加器的输入逻辑电路； (4)描述补码一位乘法过程中的重复加和移位操作。
第8题
A．r1Xr2
B．r2Xr3
C．r1Xr4
D．r2Xr4
第9题
完成下列各小题解答。
以最节省的硬件成本方案实现，填入下列元件需要的位数。 ALU=________位，MCANDR=________位，PR=________位，CR=________位。
第10题
