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[主观题]
试用集成计数器74LSl63和8选1 MUX构成010011000111长度12位的序列信号发生器。
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第1题
试用一片集成四位二进制加法计数器74LS161和一片3/8线译码器74LS138组成一个五节拍顺序脉冲发生器。
第3题
用VHDL描述下列器件的功能: (1)4选1数据选择器; (2)2线-4线译码器; (3)时钟R-S触发器; (4)带复位端Clear和置位端Preset、延迟Tpd为20ns的响应CP下降沿的J-K触发器; (5)主从J-K触发器; (6)集成计数器74163; (7)集成移位寄存器74194。
第4题
某双积分型ADC电路中计数器由四片十进制集成计数器T210组成,它的最大计数容量(N1)=(5000)10。计数脉冲的频率fC=25 kHz,积分器电阻R=100 kfl,C=1μF,输入电压0~5 V。试求: (1)第一次积分时间T1; (2)积分器的最大输出电压∣vOmax∣; (3)当VREF=±10 V,若计数器的计数值M=(1740)10。时,表示输入电压vI多少?
第5题
试用集成中规模异步二-五-十进制计数器CT74LS290设计一个输出为对称方波的十进制计数器。
第10题