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[单选题]

某SRAM存储器芯片的存储容量为16K×7位，则它的地址线和数据线引脚相加的和为（)。

A.12

B.13

C.21

D.22

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发布时间：2022-11-04

更多“某SRAM存储器芯片的存储容量为16K×7位，则它的地址线和数据线引脚相加的和为()。”相关的问题

第1题

用16K×8位的SRAM芯片组成64K×16位的存储器，该存储器按16位字编址，画出存储器扩展图。

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第2题

用存储容量为16K×1位的存储器芯片来组成一个64K×8位的存储器，则在字方向和位方向分别扩展了（

）倍。

A．4、2

B．8、4

C．2、4

D．4、8

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第3题

某SRAM芯片的存储容量为512K~8位，该芯片的地址线和数据线的数目为（)。A．64和 16B．16和64C．64

某SRAM芯片的存储容量为512K~8位，该芯片的地址线和数据线的数目为()。

A．64和 16

B．16和64

C．64和8

D．16和6

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第4题

对存储器按字节进行编址，若某存储器芯片共有8根地址线，则该存储器芯片的存储容量为【】字节。

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第5题

内存按字节编址，地址从90000H到CFFFFH，若用存储容量为16K×8位芯片构成该内存，至少需要的芯片数是

（）。

A．2

B．4

C．8

D．16

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第6题

某计算机的主存地址空间中，从地址0000H～3FFFH为ROM存储区域，从地址 4000H～7FFFH为RAM的存储

某计算机的主存地址空间中，从地址0000H～3FFFH为ROM存储区域，从地址

4000H～7FFFH为RAM的存储区域。RAM的控制信号为CS和WE，CPU的地址线为A15～A0，数据线为8位的D7～D0线，控制信号有读写控制R／W和访存请求MREQ，要求： (1)画出地址译码方案。 (2)如果ROM和RAM存储器芯片都采用8 K×1位的芯片，试画出存储器与CPU的连接图。 (3)如果ROM存储器芯片采用8K×8位的芯片，RAM存储器芯片采用4K×8位的芯片，试画出存储器与CPU的连接图。 (4)如果ROM存储器芯片采用16K×8位的芯片，RAM存储器芯片采用8K×8位的芯片，试画出存储器与CPU的连接图。

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第7题

试比较SRAM、DRAM、FlashMemory的性能特点。若某应用设计需要一种既可高速改写，又能在掉电时保存数

据的存储器，可采用哪类芯片或哪种技术？

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第8题

假定用若干个16K×1位的存储器芯片组成一个64K×8位的存储器,芯片内各单元连续编址,则地址BFFOH所在的芯片的最小地址为（)。

A.6000H

B.4000H

C.8000H

D.A000H

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第9题

某机器的寻址空间为64K，数据总线为8位。现有8K×8位SRAM芯片，SRAM有CS和WE控制信号；4K×8位DRAM芯片

，DRAM有CS、wE等控制信号，数据总线是双向。CPU有MERQ、R／W等控制信号(表示低电平有效)。 (1)写出DRAM控制器内部的逻辑部件名称； (2)从0000H开始安排32K×8位SRAM，从A000H安排8K×8位DRAM，画出CPU的DRAM存储器连接电路图(包括74LS138等组成的片选电路、DRAM控制器，DRAM控制器仅要求画出输入、输出信号)； (3)设DRAM读／写周期为0．5μs，CPU在1μs内要访问内存1次或2次，平均1μs访存约1．2次，刷新周期为2ms。有哪几种刷新方式，采用哪种刷新方式比较合理，并说明采用的刷新方式的时间参数和理由。

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第10题

试用一个具有片选使能容量为8 K×8位的SRAM芯片和必要的逻辑门，设计一个16 K×16位的存储器系统，试

试用一个具有片选使能

容量为8 K×8位的SRAM芯片和必要的逻辑门，设计一个16 K×16位的存储器系统，试画出其逻辑图。